一种氮化物器件和CMOS器件集成结构及其制备方法.pdf
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一种氮化物器件和CMOS器件集成结构及其制备方法.pdf
本申请提供一种氮化物器件和CMOS器件集成结构及其制备方法,涉及半导体技术领域,可以根据氮化物器件和CMOS器件各自所需要的不同晶向,通过对硅衬底表面的第一区域进行晶向处理从而形成(111)晶面,同时,保留硅衬底表面第二区域的(100)晶面,使得硅衬底表面同时具有第一区域的(111)晶面和第二区域的(100)晶面,从而能使得制作于第一区域的氮化物器件和制作于第二区域的CMOS器件都能够具有较高的质量,从而满足高质量器件的要求,同时也实现了具有氮化物异质结的氮化物器件与CMOS器件在硅衬底表面的集成。
HBT器件和保护电路的集成结构及其制备方法.pdf
本发明提供了一种HBT器件和保护电路的集成结构及其制备方法。通过将保护电路和HBT器件上下堆叠设置在衬底上,使得保护电路可以设置在主器件区内,而不需要在主器件区之外再额外预留空间,有效缩减了HBT器件和保护电路的总面积,大量节省了芯片空间。
一种N面GaN基CMOS器件及其制备方法.pdf
本发明提供的一种N面GaN基CMOS器件及其制备方法,通过在Si衬底上外延生长GaN缓冲层以及p‑GaN/AlGaN/GaN异质结,通过光刻选区刻蚀固定区域的p‑GaN层,随即将p‑GaN刻蚀凹槽区用绝缘介质填充。完成上述处理后,将绝缘介质使用化学机械抛光后,键合在Si(100)衬底。反转外延层,在留有p‑GaN层的区域上制备n沟道器件,并使栅区域和p‑GaN区域对齐。同时制备p沟道器件,最后将n沟道器件和p沟道器件的漏电极互联,实现CMOS器件。与传统的Ga面p沟道器件制备工艺相比,本发明能够使p沟道器
一种CMOS器件及其制造方法.pdf
本发明提供一种CMOS器件的制造方法,包括:提供衬底,所述衬底上具有沟道区域以及沟道区域上的栅介质层;在所述栅介质层上形成阻挡层;在所述阻挡层上形成功函数层;在所述功函数层上形成金属层;其中,在形成所述阻挡层之后,和/或形成所述功函数层之后,和/或形成所述金属层之后,还包括:进行等离子掺杂,等离子掺杂的离子为四族元素的离子。该方法调节阈值的控制精度高,且工艺灵活度高、简单易行,更适用于小尺寸器件中的多阈值的调控。
CMOS器件及其制造方法.pdf
本发明提供了一种CMOS器件及其制造方法,应用于半导体技术领域。在本发明提供的CMOS器件的制造方法中,并不需要像现有技术那样为了避免位于NMOS区和PMOS区之间的预留边界区(NP)出现doubleetch的情况,而加宽预留边界区(NP),本发明提供的制造方法允许预留边界区(NP)有一定宽度的doubleEtch,即形成所述开口,然后,在通过填充第二保护层的方式,将在形成源/漏区过程中导致的预留边界区(NP)引起的doubleEtch产生的开口填平,进而避免了doubleEtch产生的开口增大后