ASIC 设计流程.doc
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第一章ASIC设计流程介绍1.1引言(Introduction)在过去的几十年里,微电子技术已经逐渐成熟起来。以前很长一段时间里需要通过印刷电路版(PCB)实现的系统现在已经可以集成在一个芯片上。随着集成电路设计制造技术的快速发展,系统芯片(SOC)正在成为现实。在SOC和其它半导体电路中有一个重要的部分—专用集成电路(ASIC),它是一种用来完成某种特定功能的专用电路模块或者整块芯片。例如,我们在PC或者大量的多媒体设备中使用的视频译码器就可以做成一块ASIC芯片。这些芯片除了要具备一定的性能外,在尺寸
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传统的ASIC设计流程:定义体系结构和电器规则RTL级设计如果设计中抱憾存储单元,则插入BIST进行彻底的动态模拟,验证设计的功能正确性建立设计环境。包括工艺库,以及其他的环境属性插入扫描链(还可插入JTAG),并使用DC进行综合使用DC内置的静态时序分析工具进行模块级的静态时序分析使用Formality进行形式化验证,比较综合后的网表与RTL级模型的一致性通过PrimeTime对整个设计进行布局布线前的静态时序分析对版图工具进行时序反标约束初始化布局规划,插入时钟树,并进行全局布线在DC中将时钟树转换为
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1.使用语言:VHDL/verilogHDL-----------------------------------------------------------------------------------------------------------------------------------------------------------2.各阶段典型软件介绍:输入工具:SummitSummit公司仿真工具:VCS,VSSSynopsys公司综合器:DesignCompile,BCCompi
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