一种芯片测试方法及装置.pdf
Jo****31
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相关资料
一种芯片测试方法及装置.pdf
本发明公开了一种芯片测试方法及装置,所述方法包括:实时监测第一服务器下发的数据;当监测到符合预设数据格式的命令数据时,对所述命令数据进行解析,提取第一命令;根据与待测芯片对应的通信协议将所述第一命令转化为对应的第一命令数据包并发送至所述待测芯片,以使所述待测芯片根据所述第一命令数据包执行对应操作。根据待测芯片选择对应的通信协议,将第一服务器发送的命令转化为待测芯片可接收的数据形式执行对应操作,无需开发FLASH操作的特定协议,也不需要引入特定的调试工具,可有效降低对盲封、快封及一些不具备JTAG调试接口的
一种测试芯片的方法及装置.pdf
本发明提供了一种测试芯片的方法及装置,所述包括:在每个被测IC芯片内设置用于测试芯片正常逻辑功能的内建自测BIST电路;所述方法还包括:被测IC芯片通过数据转换逻辑电路接收来自主控IC芯片的自测试指令,进入自测模式;被测IC芯片中的内建自测电路通过数据转换逻辑电路接收来自主控IC芯片的测试数据指令,对所述被测IC芯片中的逻辑功能进行测试,返回测试结果;其中,所述数据转换逻辑电路将来自主控IC芯片的指令转换为串行信号后发送给被控IC芯片,将来自被控IC芯片的信号转换为并行信号后发送给主控IC芯片。应用本发明
一种内存芯片的测试方法及装置.pdf
本申请涉及芯片技术领域,公开了一种内存芯片的测试方法及装置,用以提高确定的初始化参数的取值的可靠性。该方法包括:采用第一二进制序列和第二二进制序列对内存芯片的初始化参数的取值进行测试,其中第二二进制序列具有H个相对于第一二进制序列的同向跳变和I个相对于第一二进制序列的反向跳变,所述内存芯片的N条数据信号线中一条数据信号线传输第一二进制序列、其它N?1条数据信号线中至少一个数据信号线传输第二二进制序列,所述H和所述I为大于或等于1的整数;根据测试得到的所述初始化参数的取值范围,确定所述初始化参数的参考取值;
芯片测试方法、装置、芯片测试机及存储介质.pdf
本申请提供一种芯片测试方法、装置、芯片测试机及存储介质,涉及芯片测试技术领域,该方法包括:确定芯片中时钟门控单元的目标使能端的目标寄存器;基于多个目标寄存器组合得到目标扫描链;通过目标扫描链上多个目标寄存器的设定值,生成目标使能信号;通过目标使能信号,控制时钟门控单元中目标使能端对应的目标时钟门控单元开启或关闭。本申请能够在生成目标扫描链的基础上,通过控制寄存器的值以控制芯片扫描测试模式下时钟门控单元的开启和关闭,降低了时钟门控单元的控制难度,有效地控制了时钟门控单元的开启比例,减少测试向量数量,提高测试
芯片测试的方法和装置.pdf
本申请提供了一种芯片测试的方法、装置、计算设备、计算机程序产品和计算机可读存储介质,涉及芯片技术领域。本申请实施例可以将从DUT获取的读数据与从数据管理单元中获取的写数据进行比对,以获得比较结果。本申请实施例通过数据管理单元实现数据比对,可以确保读数据与写数据的匹配度,使得比较结果能够反映DUT的读写能力,从而提高了芯片测试的效率。