集成电感结构及制作方法.pdf
黛娥****ak
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集成电感结构及制作方法.pdf
本发明提供一种集成电感结构,包括基体,在基体的正面结构和背面结构中分别形成有立体螺旋构型的上导电线圈和下导电线圈;上导电线圈和下导电线圈均有螺旋构型内圈的内端头和螺旋构型外圈的外端头;上导电线圈和下导电线圈除了内端头与外端头之外的其余金属走线相分离;上导电线圈和下导电线圈的内端头通过贯穿基体的第一导电通孔连接;上导电线圈和下导电线圈的外端头各自独立地引出至基体正面和背面中的一个工作面;上导电线圈的外端头与设置在相应引出工作面的线圈第二电引出端连接;下导电线圈的外端头与设置在相应引出工作面的线圈第三电引出端
半导体集成电感的制作方法及结构.pdf
本发明公开了一种半导体集成电感的制作方法,依次包括如下步骤:在硅衬底上刻蚀出多个沟槽;对沟槽之间的硅进行热氧化,使得生成的二氧化硅将所述沟槽填充;对硅片上表面进行化学机械抛光和刻蚀,保留原沟槽区域的二氧化硅;在原沟槽区域上制作半导体集成电感。本发明还公开了一种半导体集成电感的结构,包括硅衬底,所述硅衬底中由上表面向下有一个二氧化硅区域,所述二氧化硅区域上方设置所述半导体集成电感的线圈。本发明通过在衬底上制作一定宽度和间隔的深沟槽,然后对沟槽进行氧化和填充,增大电感线圈与衬底之间的间距,减少电感衬底能量损耗
图案化屏蔽结构以及集成电感.pdf
一种图案化屏蔽结构以及一种集成电感。图案化屏蔽结构设置于一电感器结构与一基板之间。图案化屏蔽结构包含一屏蔽层。屏蔽层包含一第一主干部以及多个支干部。第一主干部呈T字状。所述多个支干部连接第一主干部。
一种异形结构电感及其制作方法.pdf
一种异形结构电感及其制作方法,该异形结构电感包括电感器主体和固定在所述电感器主体下方的一对支撑脚,所述一对支撑脚为导体并与所述电感器主体的一对电极连接导通,所述一对支撑脚经配置以在安装时支撑所述电感器主体,使所述电感器主体的下方留有空隙空间。本发明的独特电感结构设计为在电感器主体下方的PCB板上安装其他元器件提供了合适的间隙,能有效地提升PCB板的面积利用率,尤其适用于电源应用中在PCB板上进行非常高密度的元器件安装。而且,通过改变所述支撑脚的相对位置,可在电感器主体的下方形成不同尺寸的下空腔,便于适应不
集成超薄大电感的扇出型系统级封装工艺及结构.pdf
本发明涉及一种集成超薄大电感的扇出型系统级封装工艺及结构。其包括如下步骤:步骤1、提供主体芯片以及待与所述主体芯片互联的功能芯片组,步骤2、将功能芯片组内的功能芯片与主体芯片内正对应的芯片功能区互联,并将用于形成磁芯电感的磁芯体置于电感功能区上,且将电感线圈连接柱单元与电感功能区适配电连接;步骤3、将上述功能芯片、磁芯体以及电感线圈连接柱单元塑封在主体芯片的正面;步骤4、在上述塑封层上制备所需的上线圈基层;步骤5、制备封装结构引出单元,以利用所制备的封装结构引出单元将所形成的封装结构引出连接。本发明能有效