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(19)中华人民共和国国家知识产权局(12)发明专利申请(10)申请公布号CN108701715A(43)申请公布日2018.10.23(21)申请号201680082427.8(51)Int.Cl.(22)申请日2016.03.31H01L29/78(2006.01)(85)PCT国际申请进入国家阶段日2018.08.22(86)PCT国际申请的申请数据PCT/JP2016/0608552016.03.31(87)PCT国际申请的公布数据WO2017/168733JA2017.10.05(71)申请人新电元工业株式会社地址日本东京都千代田区大手町二丁目2番1号(72)发明人大谷欣也(74)专利代理机构上海德昭知识产权代理有限公司31204代理人郁旦蓉权利要求书2页说明书13页附图17页(54)发明名称半导体装置的制造方法以及半导体装置(57)摘要本发明的功率半导体装置的制造方法,依次包括:半导体基体准备工序;第一沟槽形成工序;第一绝缘膜形成工序,形成第一绝缘膜126a;栅极绝缘膜形成工序;栅电极形成工序;第二沟槽形成工序,在将第一绝缘膜126a的中央部去除后在第一沟槽116内形成第二沟槽140;第二绝缘膜形成工序,以在第二沟槽内残留有空隙122为条件在第二沟槽140的内部形成第二绝缘膜126b;屏蔽电极形成工序,在空隙122内形成屏蔽电极124;以及源电极形成工序,形成源电极。根据本发明的半导体装置的制造方法,就能够简化用于使屏蔽电极与源电极之间取得连接的工序的,并且,能够以高设计自由度来制造半导体装置。CN108701715ACN108701715A权利要求书1/2页1.一种半导体装置的制造方法,用于制造具备栅电极与屏蔽电极在平面方向上分离的平面分离型屏蔽栅极构造的半导体装置,其特征在于,依次包括:半导体基体准备工序,准备具有第一导电型第一半导体层以及比该第一半导体层更低浓度的第一导电型第二半导体层的半导体基体;第一沟槽形成工序,在所述第二半导体层上形成规定的第一沟槽;第一绝缘膜形成工序,形成第一绝缘膜并使其填埋所述第一沟槽的下部;栅极绝缘膜形成工序,在所述第一沟槽的上部的侧壁上形成栅极绝缘膜;栅电极形成工序,经由所述栅极绝缘膜,形成由多晶硅构成的所述栅电极;第二沟槽形成工序,在将所述第一绝缘膜的中央部通过蚀刻去除后在所述第一沟槽内形成第二沟槽;第二绝缘膜形成工序,以在所述第二沟槽内残留有空隙为条件至少在所述第二沟槽的内部形成第二绝缘膜;屏蔽电极形成工序,在所述空隙内形成所述屏蔽电极;以及源电极形成工序,形成源电极使其与所述屏蔽电极电气连接。2.根据权利要求1所述的半导体装置的制造方法,其特征在于:其中,在所述第二绝缘膜形成工序中,形成所述第二绝缘膜使其厚度比所述栅极绝缘膜的厚度更厚。3.根据权利要求1或2所述的半导体装置的制造方法,其特征在于:其中,在所述第二绝缘膜形成工序中,在将所述空隙的底部与所述第一沟槽的底部之间的所述第二绝缘膜的厚度定为D1,所述空隙的所述底部的深度位置中所述空隙的侧壁与所述第一沟槽的侧壁之间的所述第一绝缘膜的厚度定为d,所属空隙的所述底部的深度位置中所述空隙的所述侧壁与所述第一沟槽的所述侧壁之间的所述第二绝缘膜的厚度定为D2时,形成所述第二绝缘膜使其满足D1≤d+D2的关系。4.根据权利要求1至3中任意一项所述的半导体装置的制造方法,其特征在于:其中,在所述第二沟槽形成工序中,将所述第二沟槽形成至所述第一沟槽的深度位置上。5.根据权利要求1至3中任意一项所述的半导体装置的制造方法,其特征在于:其中,在所述第二沟槽形成工序中,将所述第二沟槽形成至比所述第一沟槽的深度位置更深的深度位置上。6.根据权利要求1至5中任意一项所述的半导体装置的制造方法,其特征在于:其中,在所述第二沟槽形成工序与所述第二绝缘膜形成工序之间,进一步包括:形成第二导电型扩散区域使其与所述第二沟槽的底部相接触的第二导电型扩散区域形成工序。7.根据权利要求1至6中任意一项所述的半导体装置的制造方法,其特征在于:其中,在所述第二沟槽形成工序中,形成具有底部渐窄的锥形侧面的沟槽来作为所述第二沟槽。8.根据权利要求1至7中任意一项所述的半导体装置的制造方法,其特征在于:其中,在所述栅电极形成工序与所述第二沟槽形成工序之间,进一步包括:在从平面上看未形成有所述第一沟槽的区域中的所述第二半导体层的表面形成第二导电型基极区域的基极区域形成工序;以及在所述基极区域的表面,形成第一导电型高浓度扩散区域使其2CN108701715A权利要求书2/2页至少有一部分暴露在所述第一沟槽的所述侧壁上的第一导电型高浓度扩散区域形成工序。9.根据权利要求8所述的半导体装置的制造方法,其特征在于:其中,在所述栅电极形成工序与所述第二沟槽形成工序之间,进一步包括: