外延结构及其制备方法、半导体器件及其制备方法.pdf
春岚****23
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外延结构及其制备方法、半导体器件及其制备方法.pdf
本发明实施例公开了一种外延结构及其制备方法、半导体器件及其制备方法,该外延结构包括:衬底;半导体层,位于衬底一侧,半导体层远离衬底一侧的表面为金属极性面;氮极性面帽层,位于半导体层远离衬底的一侧。具有金属极性面的半导体层和氮极性面帽层形成复合极性外延结构,形成半导体器件时,具有强负电性的氮极性面帽层,在常温下即可与源极和漏极形成良好的欧姆接触,无需高温处理,能够降低工艺难度,半导体层可作为氮极性面帽层的湿法腐蚀自停止层,稳定阈值电压同时可提高跨导,从而提高器件性能。
外延结构、半导体器件及制备方法.pdf
本申请实施例涉及一种外延结构的制备方法、外延结构、半导体器件的制备方法以及半导体器件,通过在衬底上外延生长缓冲层;在缓冲层上外延生长第一高阻半导体层;去除部分第一高阻半导体层,形成至少两个从第一高阻半导体层的上表面延伸至第一高阻半导体层内部的凹槽,至少两个凹槽包括第一凹槽和第二凹槽,其中,第一高阻半导体层位于第一凹槽和第二凹槽之间的部分未被去除而形成隔离侧墙;在第一高阻半导体层上外延生长低阻半导体层;在低阻半导体层的位于第一凹槽内的部分之上外延生长第一器件材料层,第一器件材料层与低阻半导体层采用不同的半导
碳化硅器件外延结构及其制备方法.pdf
一种碳化硅器件外延结构及其制备方法,涉及半导体器件技术领域。该方法包括:在衬底上生长碳化硅外延层;在碳化硅外延层上沉积第一阻挡层;刻蚀第一阻挡层以形成露出碳化硅外延层的第一窗口,通过第一窗口注入N型离子以在碳化硅外延层内形成N型离子注入区;在第一阻挡层上和第一窗口内生长连续的第二阻挡层,第二阻挡层在第一窗口内围合形成第二窗口;刻蚀第二阻挡层以露出位于第二窗口处的N型离子注入区,并保留位于第一窗口侧壁的第二阻挡层以形成侧墙结构;通过离子注入在N型离子注入区内形成P型离子注入区,P型离子注入区在碳化硅外延层的
一种半导体外延结构及其制备方法、光电器件.pdf
本发明提供一种半导体外延结构及其制备方法、光电器件。所述半导体外延结构包括第一半导体层、有源层、抗静电层及第二半导体层。第一半导体层具有第一导电类型;有源层设于所述第一半导体层的一侧;抗静电层设于所述有源层背离所述第一半导体层的一侧,抗静电层包括AlN层及设于所述AlN层上的AlxInyGa1?x?yN(0≦x,y≦1)层;所述AlN层更靠近所述有源层设置;第二半导体层设于抗静电层背离所述有源层的一侧,所述第二导电层具有第二导电类型。上述半导体外延结构,抗静电层中的AlN层能够有效抑制有源层中电子溢流的同
半导体器件及其制备方法、封装件及其制备方法.pdf
本发明半导体技术领域,提出一种半导体器件,该半导体器件包括堆叠结构以及电极;堆叠结构至少包含一个芯片;电极位于堆叠结构的侧表面,电极在芯片厚度方向的长度大于或等于芯片的厚度。该半导体器件避免采用微凸起连接,使堆叠结构的厚度减薄,有利于实现薄型化。电极设于堆叠结构的侧表面,不必在布线层设置连接处,设计电路时不必考虑预留连接位置,不会造成芯片上电路布局设置的限制。电极在芯片厚度方向的长度大于或等于芯片的厚度,便于连接多个芯片上的电路。