半导体结构及其制作方法.pdf
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半导体结构及其制作方法.pdf
本申请提出一种半导体结构及其制作方法,半导体结构包含第一导电层、第一阻挡层以及绝缘层;第一导电层包含至少两条走线,相邻两条走线之间形成有凹槽;第一阻挡层设置于凹槽的侧壁;绝缘层填充于凹槽,位于凹槽的绝缘层中形成有气隙。本申请通过在凹槽的侧壁设置第一阻挡层,能够有效隔绝外界水汽由绝缘层侵入第一导电层和其他结构,同时能够利用第一阻挡层有效防止第一导电层的相邻走线之间的电迁移现象。
半导体结构及其制作方法.pdf
本申请提供一种半导体结构及其制作方法,涉及半导体技术领域,用于解决半导体结构的性能较差技术问题,该半导体结构的制作方法包括:提供衬底;在衬底上形成多个间隔设置的叠层结构,叠层结构包括依次层叠设置的第一导电层、绝缘层和第二导电层,第一导电层和第二导电层中的至少一个为半金属层;形成覆盖叠层结构的沟道层,以及覆盖沟道层的介质层;形成沿第一方向延伸的字线,字线包括多个接触部和连接相邻的接触部的连接部,接触部环绕且接触介质层的侧表面,接触部与至少部分绝缘层相对。通过设置半金属层,可以降低叠层结构与其他结构的接触电阻
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本申请涉及一种半导体结构及其制作方法。其中半导体结构的制作方法,包括:提供基片,基片包括半导体衬底、栅极结构以及介质层,半导体衬底内形成有漏区以及源区,栅极结构位于源区与漏区之间,介质层覆盖栅极结构以及半导体衬底;于基片内形成接触孔,接触孔贯穿介质层至源区和/或漏区;至少于接触孔内形成半导体连接结构,并形成接触并覆盖半导体连接结构表面的接触结构;于接触结构上形成导电结构。本申请可以降低接触结构形成时产生的应力对器件性能造成的影响。
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本申请提供一种半导体结构及其制作方法,涉及半导体技术领域,用于解决半导体结构的电学性能的可靠性差的技术问题,该半导体结构的制作方法包括:提供基底;基底包括依次相邻设置的第一N区、第一P区、第二N区和第二P区;在基底上依次层叠设置的栅介质层、第一阻挡层、第一功函数层和第二阻挡层;在第一P区和第二P区的第二阻挡层上形成掩膜层;以掩膜层为掩膜,采用第一刻蚀工艺去除第一N区和第二N区的第二阻挡层,以暴露第一N区和第二N区的第一功函数层;采用第二刻蚀工艺,去除第一N区和第二N区的第一功函数层和第一阻挡层,以暴露第一
半导体结构及其制作方法.pdf
本申请实施例涉及半导体领域,提供一种半导体结构及其制作方法,其中,制作方法包括:提供包括多个间隔排布的半导体层和位于相邻半导体层之间的隔离层,半导体层和隔离层内具有沟槽,沟槽包括依次分布的第一区、第二区和第三区;在第一区和第二区的沟槽内壁形成牺牲层;在牺牲层表面形成填充满沟槽的绝缘层;去除第二区的牺牲层和第一厚度的隔离层以形成环绕半导体层的孔隙;在露出的半导体层侧壁形成栅介质层;在沿第一区指向第三区的方向上,在栅介质层上依次堆叠形成第一栅电极层和第二栅电极层,第一栅电极层还位于剩余隔离层顶面,第二栅电极层