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一种芯片堆叠封装结构(100)、电子设备(1),涉及电子技术领域,用于解决如何在不简化芯片功能的情况下减小芯片的尺寸,并且保证芯片性能,降低芯片破裂的可能性的问题。芯片堆叠封装结构(100),包括:主堆叠结构(10),主堆叠结构(10)包括第一介电层(12)和暴露于第一介电层(12)的表面的第一凸点(13);多个副堆叠结构(30),副堆叠结构(30)包括第二介电层(32)和暴露于第二介电层(32)的表面的第二凸点(33);第一介电层(12)与第二介电层(32)贴合,第一凸点(13)与第二凸点(33)电连接;第三介电层(40),位于副堆叠结构(30)远离第一介电层(12)一侧,且与第一介电层(12)贴合。