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(19)中华人民共和国国家知识产权局(12)发明专利申请(10)申请公布号CN105374310A(43)申请公布日2016.03.02(21)申请号201510475778.2(22)申请日2015.08.05(30)优先权数据10-2014-01013242014.08.06KR(71)申请人乐金显示有限公司地址韩国首尔(72)发明人金池娥李周映苏炳成李丞晙(74)专利代理机构北京律诚同业知识产权代理有限公司11006代理人徐金国(51)Int.Cl.G09G3/20(2006.01)权利要求书2页说明书12页附图15页(54)发明名称显示装置、扫描驱动器及其制造方法(57)摘要提供了一种显示装置、扫描驱动器及其制造方法。所述扫描驱动器包括:配置成输出电源和信号的电平移位器;和扫描信号产生电路,所述扫描信号产生电路配置成基于从所述电平移位器提供的电源和信号产生扫描信号,所述扫描信号产生电路包括缓存器,所述缓存器配置成向移位寄存器的级传输时钟信号,所述缓存器包括两个反相器,所述两个反相器中的一个由多重缓存器实现。CN105374310ACN105374310A权利要求书1/2页1.一种显示装置,包括:显示面板;和扫描驱动器,所述扫描驱动器包括电平移位器和扫描信号产生电路,所述扫描信号产生电路配置成基于从所述电平移位器提供的电源和信号产生待提供给所述显示面板的扫描信号,所述扫描信号产生电路包括缓存器,所述缓存器配置成向移位寄存器的级传输时钟信号,其中所述缓存器包括两个反相器,且所述两个反相器中的一个由多重缓存器实现。2.根据权利要求1所述的显示装置,其中所述两个反相器包括第一反相器和位于所述第一反相器的后一级的第二反相器,其中所述第二反相器由所述多重缓存器实现,且所述多重缓存器具有并联结构。3.根据权利要求2所述的显示装置,其中由所述多重缓存器实现的所述第二反相器的电路构造比所述第一反相器小且简单。4.根据权利要求2所述的显示装置,其中由所述多重缓存器实现的所述第二反相器分配在所述显示面板的非显示区域中,以将由所述时钟信号的负载导致的传播延迟最小化。5.根据权利要求1所述的显示装置,其中所述扫描信号产生电路包括时钟信号产生电路,所述时钟信号产生电路配置成将从所述电平移位器提供的一个时钟信号分割为多个时钟信号,且所述时钟信号产生电路形成在所述显示面板的非显示区域中。6.根据权利要求5所述的显示装置,其中所述时钟信号产生电路包括多个分割器电路,且所述多个分割器电路的每一个包括由第一到第六NOR电路构成的T触发器。7.根据权利要求6所述的显示装置,其中所述第一NOR电路的第一输入端子与所述第三NOR电路的第三输入端子连接,所述第一NOR电路的第二输入端子与所述第三NOR电路的第一输入端子连接,所述第一NOR电路的输出端子与所述第二NOR电路的第一输入端子连接,其中所述第二NOR电路的第一输入端子与所述第一NOR电路的输出端子连接,所述第二NOR电路的第二输入端子与所述分割器电路的输入端子连接,所述第二NOR电路的输出端子与所述第五NOR电路的第一输入端子连接,其中所述第三NOR电路的第一输入端子与所述第一NOR电路的第二输入端子连接,所述第三NOR电路的第二输入端子与所述分割器电路的输入端子连接,所述第三NOR电路的第三输入端子与所述第一NOR电路的第一输入端子连接,所述第三NOR电路的输出端子与所述第六NOR电路的第二输入端子连接,其中所述第四NOR电路的第一输入端子与所述第三NOR电路的输出端子连接,所述第四NOR电路的第二输入端子与所述第六NOR电路的输出端子连接,所述第四NOR电路的输出端子与所述第三NOR电路的第三输入端子连接,其中所述第五NOR电路的第一输入端子与所述第二NOR电路的输出端子连接,所述第五NOR电路的第二输入端子与所述第六NOR电路的输出端子连接,所述第五NOR电路的输出端子与所述分割器电路的输出端子连接,且其中所述第六NOR电路的第一输入端子与所述第五NOR电路的输出端子连接,所述第六NOR电路的第二输入端子与所述第三NOR电路的输出端子连接,所述第六NOR电路的输2CN105374310A权利要求书2/2页出端子与所述第五NOR电路的第二输入端子连接。8.根据权利要求5所述的显示装置,其中所述扫描信号产生电路包括主反相器,所述主反相器配置成将所述一个时钟信号提供给所述时钟信号产生电路,且所述主反相器形成在所述显示面板的非显示区域中,且其中所述主反相器将所述一个时钟信号延迟,以输出内部时钟信号,并且所述主反相器将所述一个时钟信号延迟并反相,以输出内部反相时钟信号。9.根据权利要求8所述的显示装置,其中所述主反相器包括N1到N7晶体管和第一电容器,其中所述N1晶体管的栅极电极和第一电极与高电位电源线连接,