基于CPLD棋类竞赛计时钟.pdf
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基于CPLD棋类竞赛计时钟.pdf
目录1.总体设计思路......................................11.1基本原理......................................11.2总体设计框图..................................22.单元电路设计......................................32.1控制模块......................................32.2选择模块................
基于CPLD的多功能数字时钟.docx
前言我们已经进入了数字化和信息化的时代,其特点是各种数字产品的广泛应用。现代数字产品在性能提高、复杂度增大的同时,其更新换代的步伐也越来越快,实现这种进步的因素在于生产制造技术和电子设计技术的进步。CPLD器件和EDA技术的出现,改变了这种传统的设计思路,使人们可以立足于CPLD芯片来实现各种不同的功能,新的设计方法能够由设计者自己定义器件内部逻辑和管脚,将原来由电路板设计完成的工作大部分放在芯片的设计中进行。这样不仅可以通过芯片设计实现各种逻辑功能,而且由于管脚定义的灵活性,减轻了原理图和印制板设计的工
基于CPLD的高速时钟电路论文.doc
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cpld时钟.pdf
CPLD课程学习报告CPLD课程是一门实践性非常强的课程,它要求我们运用基本的VHDL硬件描述语言编程得到我们想要的器件以实现我们所预期的功能。这次CPLD课程学习的主要任务就是灵活地运用CPLD相关知识来设计一个数字电子钟,其基本要求是时、分、秒在数码管上的显示和小时、分钟的校准,扩展要求包括以下几点:1、整点报时:55,56,57,58,59低音响,正点高音,间断振铃(嘟--嘟--嘟--嘟--嘟--嘀)2、跑表:最大计时99分59秒999毫秒。独立的跑表功能,不影响数字钟正常工作。3、定时闹钟:可在0
基于CPLD的频率计设计.doc
内蒙古科技大学毕业设计说明书(毕业论文)题目:基于CPLD的频率计设计内蒙古科技大学毕业设计说明书(毕业论文)基于CPLD的频率计设计摘要频率计是一种基本的测量仪器,频率测量是电子学测量中最为基本的测量之一。由于频率信号抗干扰性强,易于传输,因此可以获得较高的测量精度。所以它被广泛应用于航天、电子、测控等领域。复杂可编程逻辑器件(CPLD)具有集成度高、运算速度快、开发周期短等特点,它的出现,改变了数字电路的设计方法,增强了设计的灵活性。鉴于此,本文提出了一种基于CPLD的数字频率计的设计方法。该设计电路