大学毕业论文基于fpga的数字钟设计(vhdl语言实现)[管理资料].pdf

大学毕业论文基于FPGA的数字钟设计（VHDL语言实现）摘要本设计为一个多功能的数字钟，具有年、月、日、时、分、秒计数显示功能，以24小时循环计数；具有校对功能以及整点报时功能。本设计采用EDA技术，以硬件描述语言VHDL为系统逻辑描述手段设计文件，在MaxplusII工具软件环境下，采用自顶向下的设计方法，由各个基本模块共同构建了一个基于FPGA的数字钟。系统主芯片采用EP1K100QC208-3，由时钟模块、控制模块、计时模块、数据译码模块、显示以及报时模块组成。经编译和仿真所设计的程序，在可编程逻辑器件上下载验证，本系统能够完成年、月、日和时、分、秒的分别显示，由按键输入进行数字钟的校时、清零、启停功能。关键词数字钟；硬件描述语言；VHDL；FPGA；键盘接口AbstractThedesignforamulti-functionaldigitalclock,withayear,month,day,hours,minutesandsecondscountdisplaytoa24-hourcyclecount;haveprooffunctionsandthewholepointtimekeepingfunction.TheuseofEDAdesigntechnology,hardware-descriptionlanguageVHDLdescriptionlogicmeansforthesystemdesigndocuments,inMaxplusIItoolsenvironment,atop-downdesign,bythevariousmodulestogetherbuildaFPGA-baseddigitalclock.ThemainsystemchipsusedEP1K100QC208-3,makeupoftheclockmodule,controlmodule,timemodule,datadecodingmodule,displayandbroadcastmodule.Aftercompilingthedesignandsimulationprocedures,theprogrammablelogicdevicetodownloadverification,thesystemcancompletetheyear,month,dayandthehours,minutesandsecondsrespectively,usingkeystomodify,cleared,startandstopthedigitalclock.Keywordsdigitalclock;hardwaredescriptionlanguage;VHDL;FPGA;keyboardinterface目录1绪论.......................................................................................................5选题背景..........................................................................................6课题相关技术的发展................................................................6课题研究的必要性....................................................................7课题研究的内容...............................................................................72FPGA简介............................................................................................8FPGA概述.......................................................................................8FPGA基本结构................................................................................9FPGA系统设计流程......................................................................11FPGA开发编程原理......................