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选中模块、像素行选模块及像素读出电路.pdf

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本实用新型提供一种选中模块、像素行选模块及像素读出电路,包括:一组多行选中行选单元,所述多行选中行选单元包括多个与门,各与门的输入端连接对应地址信号,输出端分别输出像素阵列中各行选信号;所述多行选中行选单元中各与门的<n:m+1>位地址分别接收其对应的/rs_add<n:m+1>,各与门的<m:0>位地址分别接收其对应的rs_addb<m:0>,且同一组多行选中行选单元中各与门依次从低位到高位按照二进制将rs_addb<m:0>替换为rs_add<m:0>的相应位;其中,/rs_add<n:m+1>为rs_add<n:m+1>的取反信号,m及n均为自然数,且m小于n。本实用新型能实现多行同时选中,大大提高像素阵列的读出速度,进而提升图像传感器的帧率。