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基于预测逻辑的SRAM数据读取系统.pdf

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本发明涉及一种基于预测逻辑的SRAM数据读取系统,包括:SRAM控制器、读地址预测模块、数据缓存器、数据选择模块和FPGA的外接SRAM,SRAM控制器用于触发所述读地址预测模块;读地址预测模块用于预测T_useri对应的M读地址,并在第i+1周期结束前从外接SRAM读取每一addrmi的数据datami存储至数据缓存器中;数据选择模块用于在T_useri+1获取在所SRAM控制器在T_useri发出的目标读地址addrxi,基于addrxi从数据缓存器中选择对应的目标读数据返回给所述SRAM控制器。本发明减小了用户最小周期,提高了FPGA中的用户最高运行频率。