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微机原理及应用2024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/82024/2/8SS0(HIGH)2024/2/82024/2/82024/2/8补充:三态门和D触发器三态缓冲器(三态门)双向三态缓冲器Intel8286常用数据缓冲器、收发器和锁存器D触发器三态缓冲锁存器(三态锁存器)锁存器74LS373缓冲器74LS244数据收发器74LS245数据收发器74LS2452024/2/82024/2/8基本控制信号的组合方法2024/2/82024/2/82024/2/82024/2/82024/2/82024/2/8存贮器的物理地址(PA)以字节为最小基本存储单元的顺序编址从00000H到FFFFFH个单元的20位绝对地址(220=1024K=1MB空间)存贮器的逻辑地址(LA)将1MB空间,小于等于216=64K连续的存储器为一段,分为多个段。每个段可以独立寻址。段地址:偏移地址的表示方法称逻辑地址。2024/2/88086同时可有4个段被激活(称当前段),即CS代码段、DS数据段、SS堆栈段、ES附加数据段。分段之间必须:〈1〉保持16个字节或其整数倍为地址间距。〈2〉16位段寄存器表示段基址。段寄存器加1实际上存储器加16。〈3〉段可连续、分散、重迭。(1)可以表为0100H:0023HPA=0100H×10H+0023H=1023H[例]:2024/2/82024/2/8存储器偶数和奇数地址的读:字/字节堆栈及堆栈段的使用若已知SS=0200H,SP=0008H,CX=12FAH,操作如图所示:操作如图所示:2024/2/82024/2/8