基于FPGA的Viterbi译码器设计与实现_刘虎.pdf
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Viterbi译码器的FPGA实现.docx
Viterbi译码器的FPGA实现标题:基于FPGA的Viterbi解码器设计与实现摘要:Viterbi译码器是一种常用于数字通信系统中的误码纠正技术。该技术基于Viterbi算法,在收到的码字序列中寻找最大可能的发送序列,从而实现误码的检测与纠正。本论文旨在提出一种基于FPGA的Viterbi解码器的设计与实现,通过硬件加速的方式来提高解码性能和减少计算开销。本文不仅介绍了Viterbi译码器的基本原理与算法,还详细描述了FPGA的设计流程以及实现过程,最后给出了性能评估结果并提出了未来的改进方向。关键
基于FPGA的高性能Viterbi译码器的设计.doc
论文原创性声明本人郑重声明:此处所呈交的论文《基于FPGA的Viterbi译码器的设计》是作者独立进行研究所取得的研究成果,除了文中特别加以标注的地方外,论文中不包含其他人已经发表或撰写过的研究成果。作者签名:邱磊日期:2009年5月18日基于FPGA的高性能Viterbi译码器的设计邱磊(哈尔滨工业大学深圳研究生院,深圳518055)摘要:卷积码的Viterbi译码算法已经被广泛地应用到通信和信号处理的各个领域。本文设计的(2,1,7)卷积码的Viterbi译码器采用串并结合的方式,兼顾了速度和面积。在
参数化Viterbi译码器的FPGA实现.pdf
分类号:——骸!参数化肼肫鞯腇迪工学硕士学位论文硕士研究生:指导教师学位级别学科、专业:所在单位论文提交日期:论文答辩日期:学位授权单位:张荣兵和应民研究员工学硕士信号与信息处理信息与通信工程学院年哈尔滨工程大学密级:编号::摘要维特比算法作为一种最大似然算法可以在网格图上找出最似然的状态转移路径已广泛应用在各种信号处理和数字通信领域。由于它的前向纠错性能维特比译码器广泛应用于各种数字通信系统如:卫星通信系统、第三代移动通信洲数字视频广播