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选通驱动器电路以及使用该选通驱动器电路的显示装置.pdf
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选通驱动器电路以及使用该选通驱动器电路的显示装置.pdf
公开了一种选通驱动器电路以及使用该选通驱动器电路的显示装置。所述选通驱动器电路包括：第一晶体管，其响应于时钟将起始信号供应给Q节点；第二晶体管，其响应于时钟调节第一晶体管的选通电压；第三晶体管，其响应于起始信号调节第二晶体管的选通电压；第四晶体管，其改变QB节点的电压；第五晶体管，其响应于第一行控制信号来切换第一晶体管与Q节点之间的电流路径；第六晶体管，其将栅极截止电压供应给输出节点；第七晶体管，其将栅极导通电压供应给输出节点；以及第八晶体管，其将第二行控制信号供应给QB节点。
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选通驱动器以及包括该选通驱动器的显示装置.pdf
提供了一种选通驱动器以及包括该选通驱动器的显示装置，其可通过稳定地维持上拉节点的放电电位来防止从级异常输出选通高电压。该选通驱动器包括多个级，各个级包括：上拉晶体管，其根据上拉节点的电压来将输入到第一时钟端子的时钟信号输出给输出端子；下拉晶体管，其根据下拉节点的电压来将输入到第一源电压端子的第一源电压输出给输出端子；以及第一噪声去除单元，其响应于输入到第一时钟端子的时钟信号，来将选通关闭电压供应给上拉节点以去除上拉节点的噪声。
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讨论的是能够通过降低时钟线的负载来改善选通驱动器的输出特性的内置选通驱动器及使用该内置选通驱动器的显示装置。该内置选通驱动器可以包括位于显示面板的非显示区域中的移位寄存器、第一时钟组以及第二时钟组。移位寄存器包括用于分别驱动显示区域的选通线的多个级。第一时钟组包括被布置在移位寄存器的第一侧的时钟线。第二时钟组包括被布置在所述移位寄存器的第二侧的时钟线。每个时钟线均包括主线和从主线分支并被连接到对应的级的支线。属于第一时钟组和第二时钟组中的任何一个的对应的时钟组的支线与属于另一个时钟组的主线不交叠。
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选通驱动器和包括该选通驱动器的显示装置.pdf
讨论了一种选通驱动器和包括该选通驱动器的显示装置。该选通驱动器包括彼此相关地连接的多个级。所述多个级中的每一个包括：输出单元，其通过RQ节点的电压、PQ节点的电压和QB节点的电压输出选通电压；第一控制器，其控制RQ节点；第二控制器，其控制PQ节点；以及第三控制器，其控制QB节点。所述选通电压由具有第一相位的第一时钟信号和具有不同于第一相位的第二相位的第二时钟信号配置。
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选通驱动器和具有该选通驱动器的显示装置.pdf
本公开涉及选通驱动器和具有该选通驱动器的显示装置。一种显示装置包括：像素阵列、定时控制器、Q节点控制信号输入线和移位寄存器。在所述像素阵列中，限定有数据线和选通线并且像素被布置成矩阵。所述定时控制器输出起始信号和第一复位信号。所述Q节点控制信号输入线接收所述起始信号和所述第一复位信号。所述移位寄存器包括级联连接的多个级，并且依次提供施加至所述选通线的虚拟选通脉冲或选通脉冲。
2023-12-05
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