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(19)中华人民共和国国家知识产权局(12)发明专利申请(10)申请公布号(10)申请公布号CNCN104115231104115231A(43)申请公布日2014.10.22(21)申请号201180076441.4(22)申请日2011.12.23(85)PCT国际申请进入国家阶段日2014.08.22(86)PCT国际申请的申请数据PCT/US2011/0672742011.12.23(87)PCT国际申请的公布数据WO2013/095667EN2013.06.27(71)申请人英特尔公司地址美国加利福尼亚州(72)发明人F.朱P.卡拉瓦德I.朝(74)专利代理机构中国专利代理(香港)有限公司72001代理人徐予红汤春龙(51)Int.Cl.G11C16/06(2006.01)G11C16/08(2006.01)权权利要求书3页利要求书3页说明书11页说明书11页附图11页附图11页(54)发明名称用于确定对存储器阵列的访问的方法、装置和系统(57)摘要本发明涉及用于确定对存储器阵列的访问的序列的技术和机制。在实施例中,存储器阵列包括彼此交错的多级单元和单级单元,其中这些多级单元和单级单元的位不同地分配给不同的逻辑页。在另一个实施例中,访问存储器阵列的请求根据页轮序列排序以避免包括相邻多级单元的连续访问类型的访问事件。CN104115231ACN104523ACN104115231A权利要求书1/3页1.一种存储器设备,其包括:硬件接口,用于接收信息以用于访问存储器阵列,所述存储器阵列包括存储器单元的单元邻接集,其包括作为多级单元(MLC)操作的第一存储器单元和至少部分与所述第一存储器单元交错的第二存储器单元,所述第二存储器单元作为单级单元(SLC)操作,其中存储器单元的所述单元邻接集的位属于多个逻辑页的相应页;定序器,其耦合于所述硬件接口,所述定序器包括电路逻辑,所述电路逻辑用于基于接收的信息生成信号以根据页轮序列来对存储器单元的所述单元邻接集的访问排序以避免出现以下访问事件,其中第一MLC的位在第一页轮期间访问并且第二MLC的位在所述页轮序列中紧跟所述第一页轮的第二页轮期间访问,并且其中所述第一MLC和所述第二MLC在单元激活线的方向上彼此单元相邻。2.如权利要求1所述的存储器设备,存储器单元的所述单元邻接集具有平均每单元一又二分之一位。3.如权利要求1所述的存储器设备,其中所述单元激活线的所述方向是所述存储器阵列的字线的方向。4.如权利要求1所述的存储器设备,其中所述单元激活线的所述方向是所述存储器阵列的位线的方向。5.如权利要求1所述的存储器设备,其中所述第一存储器单元的分布和所述第二存储器单元的分布形成棋格分布模式。6.如权利要求1所述的存储器设备,所述存储器阵列进一步包括第一字线,其中第一逻辑页包括要用所述第一字线来访问的所述第一存储器单元的第一位,其中第二逻辑页包括要用所述第一字线来访问的所述第一存储器单元的第二位,其中第三逻辑页包括要用所述第一字线来访问的所述第二存储器单元的专用位。7.如权利要求6所述的存储器设备,其中所述第一逻辑页对应于MLC的第一位,其中所述第二逻辑页对应于MLC的第二位,并且其中所述第三逻辑页对应于SLC的专用位。8.如权利要求1所述的存储器设备,所述存储器阵列包括多个字线,每个字线对应于逻辑页的不同相应集。9.如权利要求8所述的存储器设备,其中对于所述多个字线中的每个,对应于所述字线的逻辑页的集中的每个逻辑页对应于以下中的不同的相应一个:要用所述字线来访问的MLC的第一位;要用所述字线来访问的MLC的第二位;以及要用所述字线来访问的SLC的专用位。10.一种方法包括:接收信息用于访问存储器阵列,所述存储器阵列包括存储器单元的单元邻接集,其包括作为多级单元(MLC)操作的第一存储器单元和至少部分与所述第一存储器单元交错的第二存储器单元,所述第二存储器单元作为单级单元(SLC)操作,其中存储器单元的所述单元邻接集的位属于多个逻辑页的相应页;基于接收的信息生成信号以根据页轮序列来对存储器单元的所述单元邻接集的访问排序以避免出现以下访问事件,其中第一MLC的位在第一页轮期间访问并且第二MLC的位在所述页轮序列中紧跟所述第一页轮的第二页轮期间访问,并且其中所述第一MLC和所述2CN104115231A权利要求书2/3页第二MLC在单元激活线的方向上彼此单元相邻。11.如权利要求10所述的方法,存储器单元的所述单元邻接集具有平均每单元一又二分之一位。12.如权利要求10所述的方法,其中所述单元激活线的所述方向是所述存储器阵列的字线的方向。13.如权利要求10所述的方法,其中所述单元激活线的所述方向是所述存储器阵列的位线的方向。14.如权利要求10所述的方法,其中所述第一存储器单元的分布和所述