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(19)中华人民共和国国家知识产权局*CN103036821A*(12)发明专利申请(10)申请公布号CN103036821A(43)申请公布日2013.04.10(21)申请号201210376162.6(22)申请日2012.10.08(30)优先权数据13/269,0642011.10.07US(71)申请人英特尔移动通信有限责任公司地址德国诺伊比贝格(72)发明人I.舒斯特J.瓦尔(74)专利代理机构中国专利代理(香港)有限公司72001代理人张涛卢江(51)Int.Cl.H04L25/02(2006.01)H04L25/03(2006.01)权利要求书权利要求书3页3页说明书说明书1313页页附图附图1414页(54)发明名称用于接合射频收发器与基带处理器的方法和接口(57)摘要一种用于接合射频收发器与基带处理器的接口包括三个子接口。第一子接口配置为接收第一输入IQ数据流,对第一输入IQ数据流进行分包以获得第一输入IQ数据包,并经第一组RX线道把第一输入IQ数据包传输至基带处理器。第二子接口配置为接收第二输入IQ数据流,对第二输入IQ数据流进行分包以获得第二输入IQ数据包,并经第二组RX线道把第二输入IQ数据包传输至基带处理器。第三子接口配置为经TX线道从基带处理器接收输出IQ数据包,并对输出IQ数据包进行拆包以获得输出IQ数据流。第三子接口还配置为还经TX线道从基带处理器接收RX未确认信号。CN103682ACN103036821A权利要求书1/3页1.一种用于接合射频收发器与基带处理器的接口,该接口包括:第一子接口,配置为接收第一输入IQ数据流,对第一输入IQ数据流进行分包以获得第一输入IQ数据包,并经第一组RX线道把第一输入IQ数据包传输至基带处理器,其中每个第一输入IQ数据包包括共同的一组可能的数据包标识符之中的数据包标识符;第二子接口,配置为接收第二输入IQ数据流,对第二输入IQ数据流进行分包以获得第二输入IQ数据包,并经第二组RX线道把第二输入IQ数据包传输至基带处理器,其中每个第二输入IQ数据包包括共同的一组可能的数据包标识符之中的数据包标识符;和第三子接口,配置为经TX线道从基带处理器接收输出IQ数据包,并对输出IQ数据包进行拆包以获得输出IQ数据流;其中第三子接口配置为还经TX线道从基带处理器接收RX未确认信号,其中RX未确认信号通过指示第一和第二输入IQ数据包内的有错误的第一或第二输入IQ数据包的数据包标识符和传输所述有错误的第一或第二输入IQ数据包的第一或第二组RX线道识别所述有错误的第一或第二输入IQ数据包。2.根据权利要求1所述的接口,其中第一和第二子接口配置为单独地以及并行地对各自的第一和第二输入IQ数据包进行分包。3.根据权利要求1所述的接口,其中所述第三子接口配置为在与接口的增强模式对应的启用状态和与接口的正常模式对应的禁用状态之间切换第二子接口。4.根据权利要求3所述的接口,其中所述第三子接口配置为根据来自基带处理器的接口控制信号执行切换。5.根据权利要求1所述的接口,其中所述第一子接口配置为接收RX控制信号,对RX控制信号进行分包以获得RX控制包,并经第一组RX线道把RX控制包传输至基带处理器;以及其中第三子接口配置为经TX线道从基带处理器接收TX控制包,并从TX控制包获得TX控制信号。6.根据权利要求3所述的接口,其中所述第三子接口配置为在正常模式下忽略RX未确认信号的与第一组RX线道的标识符对应的部分,并在增强模式下使用RX未确认信号的与第二组RX线道的标识符对应的部分。7.根据权利要求1所述的接口,其中所述第一输入IQ数据包和第二输入IQ数据包、输出IQ数据包和RX未确认信号分别属于不同的逻辑信道,并包括指示各自逻辑信道的头。8.根据权利要求1所述的接口,其中所述第一子接口包括第一缓冲器,第一缓冲器配置为缓冲第一输入IQ数据流的一部分并根据RX未确认信号重发缓冲的第一输入IQ数据流的该部分,以及其中第二子接口包括第二缓冲器,第二缓冲器配置为缓冲第二输入IQ数据流的一部分并根据RX未确认信号重发缓冲的第二输入IQ数据流的该部分。9.根据权利要求1所述的接口,其中所述第一子接口的第一组RX线道包括多个RX线道,并且其中第二子接口的第二组RX线道包括多个RX线道。10.根据权利要求1所述的接口,其中所述第一子接口包括配置为把多个输入IQ数据流复用为第一输入IQ数据流的第一复用器,并且其中第二子接口包括配置为把多个输入IQ数据流复用为第二输入IQ数据流的第二复用器。2CN103036821A权利要求书2/3页11.根据权利要求1所述的接口,其中所述第三子接口配置为执行前向检错以便识别有错误的输出IQ数据包,并输出通过指示输出IQ数据包内的有错误的输出IQ数据包的数据包标识符识别所述有